本文在分析可扩展安全计算机平台实时性和安全性要求的基础上,提出基于可编程逻辑器件(FPGA)和时钟级同步2取2结构的安全输入/输出(安全I/O)模块的设计方法。深入阐述了安全I/O模块的硬件设计原理和基于PSL语言的断言验证方案。功能仿真和形式化验证结果说明了设计的正确性,同时在EDA开发平台上长时间稳定性的测试结果也证明了安全I/O模块的正确性和安全性。
数字量输入模块是某通用测试台的一部分;其主要功能是接收遥测PCM码流,并对其进行解码,为后续的传输存储做准备;该设计涉及同步时钟和异步时钟的PCM解码的实现,并对解码过程中的误差问题进行了分析和说明;模块采用FPGA作为中心逻辑控制器,可以对几种电平形式的遥测PCM码进行解码,具有较强的通用性;该设计已经应经成功的应用于某通用测试台。
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