本文给出了一种采用Altera公司的Cyclone系列EP1C12Q240C8的FPGA芯片设计磁盘阵列校验卡的硬件电路的方法。该设计采用了并行的思想,令数据在PCI总线上的传输过程和校验计算过程在时间上重叠,使得整个校验过程耗费的时间等同于数据在总线上传输的时间,从而最大限度地提高了校验性能。设计经软件仿真和硬件实现,结果表明电路性能可靠。
针对局域网网络线中只有4根线在使用,有4根线空闲的情况,提出了可以让空闲的4根线也用来发送和接收数据这一创新观点,并介绍了新的8线制10/100M自适应网卡设计方案及其工作原理。分析表明,局域网中一旦采用了这种新设计的网卡,绝大部分线路故障都可以得到解决。
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