74hc138译码器,74hc138译码器知识 - 工程造价

EDA：4-16译码器电路的设计

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1 院（系）名称班别姓名专业名称学号实验课程名称 EDA 技术与应用实验项目名称 4-16译码器电路的设计实验时间实验地点实验成绩指导老师签名【实验目的】 1. 了解 QuartusII 中电路图输入和 VHDL 程序输入方式。 2. 掌握基于 FPGA 的 4-16 译码器电路的设计方法。【实验元器件和模块】元器件：按键、发光二极管模块： 4-16 译码器 decoder4_16 模块【实验步骤】首先要建立设计项目，然后在 Quartus II 集成环境下，执行“ File ”菜单的“ New”命令，或者直接按主窗口上的“创建新的文本文件”按钮，在弹出的新文件类型选择对话框中，选择 “ VHDL File ”，进入Quartus II 的 VHDL 文本编辑方式。编辑源程序 decoder4_16.vhd 。 library ieee; use

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74HC(T)163

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DATA SHEET Product speci?cation File under Integrated Circuits, IC06 December 1990 INTEGRATED CIRCUITS 74HC/HCT163 Presettable synchronous 4-bit binary counter; synchronous reset For a complete data sheet, please also download: ? The IC06 74HC/HCT/HCU/HCMOS Logic Family Specifications ? The IC06 74HC/HCT/HCU/HCMOS Logic Package Information ? The IC06 74HC/HCT/HCU/HCMOS Logic Package Outlines Decem

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